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新思科技(Synopsys, Inc.)近日发布与台积公司合作,基于台积公司N4P制程手艺开发普遍的Synopsys DesignWare®接口和基本IP核组合,以促进芯片立异,助力开发者快速地成功设计出复杂的高机能计较(HPC) 和移动SoC。基于这一合作,开发者可基于台积公司的前进前辈制程手艺使用高质量IP核以实现设计和项目进度的严苛要求,并在机能、功耗、面积、带宽和延迟等方面进行优化。

新思科技普遍的DesignWare IP核组合搜罗逻辑库、嵌入式存储器、IO、PVT看管器、嵌入式测试、模拟IP、接口IP、平安IP、嵌入式措置器和子系统。为了加速原型设计、软件开发以及将IP核整合进芯片,新思科技“IP Accelerated”打算供给IP核原型设计套件、IP核软件开发套件和IP核子系统。我们在IP核质量和周全手艺撑持方面进行了年夜量投资,以协助开发者降低集成风险,缩短产物上市时刻。台积公司N4P制程手艺上的DesignWare接口和基本IP核打算于2022年第一度最先上市。(最新消息,2021年11月19日加利福尼亚州山景城)

阅读全文: 新思科技和台积公司敦促芯片立异,开发基于N4P制程手艺的最普遍IP核组合

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